चित्र:JFET Transistor.svg
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सारांश
| विवरण |
Polski: Uproszczona budowa tranzystora polowego złączowego (JFET): S – źródło, D – Dren, G – Bramka, 1 – Ładunek przestrzenny, 2 – Kanał. |
| दिनांक | |
| स्रोत | Na podstawie: Stacewicz T., Kotlicki A., Elektronika w laboratorium naukowym, Wydawnictwo Naukowe PWN, Warszawa 1994, ISBN 83-01-11531-9 |
| लेखक | वेक्टरीकरण: Harkonnen² |
लाइसेंस
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चित्र का इतिहास
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| दिनांक/समय | थंबनेल | आकार | सदस्य | टिप्पणी | |
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| वर्तमान | १९:१५, २४ जून २००७ | | ६०० × २१० (९ KB) | wikimediacommons>Harkonnen2 | {{Information |Description=Uproszczona budowa tranzystora polowego złączowego (JFET); S- źródło, D - Dren, G - Bramka; 1. Ładunek przestrzenny, 2. Kanał |Source=Stacewicz T., Kotlicki a., "Elektronika w laboratorium naukowym", Wydawnictwo naukowe P |
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